Módulos SoM FPGA
SoM FPGA de Gama Alta AMD Kintex UltraScale XCKU095
€2,180Impostos não inclusos Ver detalhes →
O SoM DUKU15P é construíd sobre o FPGA industrial AMD Xilinx Kintex UltraScale+ XCKU15P-2FFVE1517I, integrando 1.143K células lógicas, 523K LUTs, 1.968 blocos DSP, 34,6 Mb de Block RAM e 36 Mb de UltraRAM. Carrega 24 transceptores GTY de 28,05 Gbps e 32 transceptores GTH de 16,3 Gbps (56 no total), um núcleo rígido PCIe Gen3 x16, quatro núcleos rígidos Interlaken de 150G e quatro núcleos rígidos Ethernet de 100G. O SoM de 80×80 mm usa design de PCB de 18 camadas e roteia todos os 88 pares de E/S HD e 236 pares de E/S HP por quatro conectores board-to-board de 240 pinos, acompanhado de 8 GB DDR4 ECC, 256 MB QSPI Flash dual-backup, um relógio programável de baixo jitter (
Interface, refrigeração, estrutura e fornecimento em lote podem ser customizados por projeto · respondemos em até 1 dia útil após o envio.
O SoM DUKU15P é construíd sobre o FPGA industrial AMD Xilinx Kintex UltraScale+ XCKU15P-2FFVE1517I, integrando 1.143K células lógicas, 523K LUTs, 1.968 blocos DSP, 34,6 Mb de Block RAM e 36 Mb de UltraRAM. Carrega 24 transceptores GTY de 28,05 Gbps e 32 transceptores GTH de 16,3 Gbps (56 no total), um núcleo rígido PCIe Gen3 x16, quatro núcleos rígidos Interlaken de 150G e quatro núcleos rígidos Ethernet de 100G. O SoM de 80×80 mm usa design de PCB de 18 camadas e roteia todos os 88 pares de E/S HD e 236 pares de E/S HP por quatro conectores board-to-board de 240 pinos, acompanhado de 8 GB DDR4 ECC, 256 MB QSPI Flash dual-backup, um relógio programável de baixo jitter (<0,5 ps RMS) e monitoramento de energia PMBus. Pode ser montado diretamente na sua própria placa portadora para cenários de rede 100G, aquisição de dados de alta velocidade, ATE semicondutor, processamento de sinais de radar e processamento de vídeo e imagem. O SoM é fornecido isoladamente; placas portadoras personalizadas (placa PCIe, portadora FMC, portadora de rede 100G) estão disponíveis. A configuração final está sujeita a confirmação comercial.
| Parâmetro | Especificação |
|---|---|
| Modelo do Produto | DUKU15P V1.0 |
| Chip FPGA | AMD Xilinx Kintex UltraScale+ XCKU15P-2FFVE1517I |
| Speed Grade / Temperatura | Speed grade -2 · Industrial -40°C ~ 85°C |
| Encapsulamento | FFVE1517 (FCBGA 45×45 mm, 1516 pinos) |
| Células Lógicas do Sistema | 1.143K Logic Cells |
| LUTs CLB / Flip-Flops | 523K LUTs / 1.045K Flip-Flops |
| Block RAM / UltraRAM | 34,6 Mb Block RAM + 36 Mb UltraRAM |
| Blocos DSP | 1.968 (multiplicadores 27×18) |
| Gerenciamento de Relógios | 11 Clock Management Tiles (MMCM + PLL) |
| Transceptores GTY | 24 pares, até 28,05 Gbps por via |
| Transceptores GTH | 32 pares, até 16,3 Gbps por via |
| PCI Express | 1× IP rígido PCIe Gen3 x16 (8,0 GT/s) |
| IP Rígido de Interface de Alta Velocidade | 4 × 150G Interlaken · 4 × 100G Ethernet |
| E/S do Usuário | 88 pares de E/S HD + 236 pares de E/S HP |
| Memória a Bordo | 8 GB DDR4, barramento de dados de 64 bits + ECC de 8 bits (dispositivos ×16) |
| Flash de Configuração | 256 MB QSPI (boot dual-backup A/B) |
| Fonte de Relógio | Relógio programável de baixo jitter a bordo (<0,5 ps RMS) + 2 × osciladores de baixo jitter de 156,25 MHz |
| Monitoramento de Energia | Monitoramento de corrente/tensão PMBus TI INA226 + sensor de temperatura LM75 a bordo |
| Conectores Board-to-Board | 4 × conectores de alta densidade de 240 pinos (quatro lados) |
| Alimentação | +12V via portadora; árvore de energia multi-trilho a bordo (0,85V / 0,9V / 1,2V / 1,8V / 3,3V) |
| Estrutura PCB | 80 × 80 mm · HDI de 18 camadas · impedância controlada |
| Resfriamento | SoM nu; dissipador/ventilador na portadora (opcional conforme aplicação) |
Estações-base 5G/6G e equipamentos de rede de alta velocidade impõem requisitos rigorosos de processamento de protocolos, encaminhamento de dados e latência determinística. Com transceptores de alta velocidade, pilhas de protocolos reconfiguráveis e pipelines paralelos, a FPGA alimenta comunicação óptica de 100G, processamento de protocolos e aceleração de segurança de rede, fornecendo uma plataforma de hardware de alta vazão e baixa latência, da P&D à produção em massa.
Radar de arranjo de fases e radar de imagem impõem requisitos rigorosos às plataformas de processamento de sinais: aquisição paralela multicanal, fluxo de dados de alta vazão e baixa latência determinística. Com sua arquitetura paralela reconfigurável, a FPGA serve como o núcleo do processamento de sinais de radar, oferecendo computação paralela multicanal, de alta vazão e baixa latência determinística em formação de feixe, compressão de pulso e detecção de alvos, além de suportar reconfiguração de algoritmos e evolução da plataforma.
De laboratórios universitários à pré-pesquisa empresarial, verificar rapidamente algoritmos e arquiteturas de hardware é o primeiro passo crítico para o sucesso do projeto. As placas de desenvolvimento FPGA e SoMs da Duyuan fornecem interfaces de alta velocidade, designs de referência completos e suporte técnico ponta a ponta para verificação de protótipos ASIC, aquisição de dados de alta velocidade, desenvolvimento de instrumentos e pesquisa acadêmica — ajudando as equipes a transformar ideias em sistemas de hardware funcionais rapidamente.
Vídeo 4K/8K, visão de máquina e câmeras industriais impõem requisitos rigorosos de latência ponta a ponta e cobertura de interfaces. Com caminhos de vídeo diretos em hardware e pipelines paralelos, a FPGA oferece processamento determinístico em nível de microssegundos em codificação/decodificação de vídeo, pré-processamento de imagem, interfaces multiprotocolo e transporte de baixa latência, suportando personalização profunda de serviços de vídeo e algoritmos de visão.
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